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2009组成原理试题(A卷)


课程名称:计算机组成原理

(A卷

闭卷)

3、CPU 内通用寄存器的位数取决于___B___。 A.存储器字长 B. 机器字长 适用专业:计算机科学与技术 09 级 考试时间:100 分钟 C. 指令的长度 D. CPU 的管脚数 4、某一 RAM 芯片,其容量为 512×8 位,除电源和接地端外,该芯片引出线的最小数目应是___D___。 题号 一 二 三 四 五 六 总分 A. 23 B. 25 C. 50 D. 19 统分人 5、下列说法中,正确的是___B___。 签名 题分 30 20 12 38 100 A. 多模块存储器主要解决扩充存储容量的问题 B. Cache 的功能完全由硬件实现 得分 C. Cache 与主存统一编址 D. 主存都是由易失性的随机读/写存储器构成的 6、堆栈寻址方式中,设 A 为通用寄存器,SP 为堆栈指示器,MSP 为 SP 指示器的栈顶单元,如果操作的动作是: 考生注意事项:1、本试卷共 2 页,试卷如有缺页或破损,请立即举手报告以便更换。 2、考试结束后,考生不得将试卷、答题纸和草稿纸带出考场。(答案请写在密封 (A)→MSP , (SP)-1 →SP,那么出栈的动作应是__B____。 线内和纸卷正面,否则不记分) A.(MSP)→A, (SP)+1→SP B.(SP)+1→SP, (MSP)→A C. ( SP ) -1 → SP , (MSP)→A 一、 填空题(每题 3 分,共 30 分) D.(MSP)→A, (SP)-1→SP 1、 码值 80H: 若表示真值 0, 则为 A.___移___码; 若表示-128, 则为 B.____补__码; 若表示-127, 7、指令周期是指____C__。 则为 C.____反__码。 A. CPU 从主存取出一条指令的时间 2、在浮点加法运算中,主要的操作步骤是 A.__对阶____, 尾数相加,B.__规格化___,舍入,C.__ B. CPU 执行一条指令的时间 判断溢出____。 C. CPU 从主存取出一条指令加上 CPU 执行这条指令的时间 3、 存储器的技术指标有 A.__存储容量____, B.__存储时间____, C.__存储周期____, 存储器带宽。 D. 时钟周期时间 4、计算机并行处理技术的主要形式有 A.___空间并行___,B.__时间并行____和 C._空间+时间并 8、对于补码或反码表示的机器数,算术右移指令执行的操作是___A___。 行_____三种。 A. 符号位不变,并顺次向右移 1 位,最低位移至进位标志位 5、CPU 中至少有如下六类寄存器,除了 A._指令__寄存器,B.___程序___计数器,C.__地址____ B. 符号位填 0,并顺次向右移 1 位,最低位移至进位标志位 寄存器外,还应有通用寄存器,状态条件寄存器,数据缓冲寄存器。 C. 符号位填 1,并顺次向右移 1 位,最低位移至进位标志位 6、总线有 A.__机械____特性,B.___功能___特性,电气特性,C.____时间__特性。 D. 进位标志位移至符号位,顺次向右移 1 位,最低位移至进位标志位 7、 使用高速缓冲存储器是为了解决 A.___存储速度问题___, 存储管理主要由 B.__硬件____实现, 9、在微型机系统中,外围设备通过__A____与主板的系统总线相连接。 使用虚拟存储器是为了解决容量问题,存储管理主要由 C._软件_____实现。 A. 适配器 B.设备控制器 C. 计数器 D.寄存器 8、中断处理需要有中断 A._ 优先级仲裁_____,中断 B._向量_____产生,中断 C._控制逻辑_____ 10、如果有多个中断同时发生,系统将根据中断优先级响应优先级高的中断请求。若要调整中断事件的响应 等硬件支持。 次序,可以利用____D__。 9、硬布线控制器的基本思想是:某一微操作控制信号是 A.___指令操作码___译码输出, B.__节 A.中断嵌套 B.中断向量 C.中断响应 D.中断屏蔽 拍____信号, C.___标志___信号的逻辑函数。 10、在微程序控制器中,A.__控制存储器____用来存放机器指令系统功能的微程序,它一般是高 三、 计算题(每题 6 分,共 12 分) 速的 B.__只读存储器____,这个存储器的地址称为 C.__微地址____。

湖南工业大学考试试卷纸

班级 课程名称 计算机组成原理

姓名 密封线

学号

二、 选择题(每题 2 分,共 20 分)
1、完整的计算机应包括__D____。 A. 运算器、存储器、控制器 B. 外部设备和主机 C. 主机和实用程序 D. 配套的硬件设备和软件系统 2、用 64 位字长(其中 1 位符号位)表示定点小数时,所能表示的数值范围是__B____。 64 63 62 63 A. [ 0,2 – 1 ] B. [ 0,2 – 1 ] C. [ 0,2 – 1 ] D. [ 0,2 ]

系(院)

1、已知 x=-0.1110,y=-0.1101,求[x.y]原 .(要求画出数值部分计算列表) 2、CPU 执行一段程序时,cache 完成存取的次数为 2000 次,主存完成存取的次数为 50 次。已知 cache 存 周期为 50ns,主存存取周期为 200ns。求: (1)Cache 命中率 H。 (2)效率 E。 (3)平均访问时间 Ta。



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四、 应用题(第 1 题 14 分,第 2、3 题各 12 分,共 38 分)
1、设 CPU 有 16 根地址线、8 根数据线,并用 MREQ 作为访存控制信号(低电平有效) ,用 WR 作为 读/写控制信号(高电平为读,低电平为写) 。现有下列存储芯片:1K*4 位 RAM、4K*8 位 RAM、 8K*8 位 RAM、2K*8 位 ROM、4K*8 位 ROM、8K*8 位 ROM 及 74138 译码器和各种门电路。画出 CPU 与存储器的连接图,要求如下: (1)主存地址空间分配:6000H—67FFH 为系统程序区;6800—6BFFH 为用户程序区。 (2)合理选用上述存储芯片,说明各选几片。 (3)详细画出存储芯片的片选逻辑图。 2、设某机配有基址寄存器和变址寄存器,采用一地址格式的指令系统,允许直接和间接寻址,且 指令字长、机器字长和存储字长均为 16 位。 (1)若采用单字长指令,共能完成 105 种操作,则指令可直接寻址的范围是多少?一次间接寻 址的寻址范围是多少?画出其指令格式并说明各字段的含义。 (2)若存储字长不变,可采用什么方法直接访问容量为 16MB 的主存? 3、 (1)画出一种单总线结构的 CPU 内部结构图(寄存器级) 。 (2)拟出加法指令“ADD (R0),R1”的读取与执行流程。该指令的目的寻址方式为寄存器间址 方式,而源操作数在 R1 中。
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课程名称 计算机组成原理 班级 系( 院 )

姓名 密封线

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